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中国大学MOOC数字逻辑与数字电路（数字电子技术）作业答案

数字逻辑与数字电路（数字电子技术）

学校: 九八五题库

学校: 超星学习通

题目如下：

1. 1. 用公式法化简为最简与或式是（ ）。

A.

B.

C.

D.

答案:

2. 2. 下列各式中错误的是（ ）。

A.

B.

C.

D.

答案:

3. 3.

A. 1

B. A

C. C

D. B

答案: A

4. 4. 逻 辑 式，化 简 后 为( )。

A.

B.

C.

D.

答案:

5. 5. 用公式法化简为最简与或式为( )。

A.

B.

C.

D.

答案:

6. 1. 约束项就是逻辑函数中不可能出现或者不允许出现的变量取值组合对应的最小项，用卡诺图化简时，可将约束项当作（ ）。

A. 当作1

B. 当作 0

C. 当作1，也可当作 0

D. 即不当作1，也不可当作 0

答案: 当作1，也可当作 0

7. 2. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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8. 3. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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9. 4. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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10. 1. 图所示电路中的ttl门是：（ ）

A. OD门

B. OC门

C. 三态门

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11. 2. 图所示电路中输出Y的表达式为：（ ）

A.

B.

C.

D.

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12. 3. OC门在使用时须在( )之间接一电阻。

A. 输出与地

B. 输出与电源

C. 输出与输入

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13. 4. 逻辑表达式Y=AB可以用( )实现。

A. 正或门

B. 正非门

C. 正与门

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14. 5. 能实现“线与”逻辑功能的门为（）

A. TTL三态门

B. OC门

C. TTL与非门

D. TTL或非门

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15. 6. 一般TTL门电路的输出端可以直接相连,实现线与。

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16. 7. TTL OC门(集电极开路门)的输出端可以直接相连,实现线与。

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17. 8. 对于TTL与非门,只要有一个输入为低电平,输出即为高电平,所以对与非门多余输入端的处理不能接低电平。

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18. 1. 写出下图所示门电路的输出： 若该门电路为TTL电路， Y11=

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19. 2. 写出下图所示门电路的输出： 若图所示门电路为CMOS电路，Y11=

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20. 3. 已知NMOS管和PMOS管的开启电压分别为2V和－2V，导通后电阻为500欧姆。则对于右图所示MOS管电路，当输入电压uI=0V时，MOS管的状态和输出电压为：（ ）

A. MOS管截止，输出电压uO=10V

B. MOS管导通，输出电压uO≈0V

C. MOS管导通，输出电压uO=10V

D. MOS管截止，输出电压uO=0V

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21. 4. CMOS逻辑电路是以( )为基础的集成电路

A. 三极管

B. NMOS管

C. PMOS管

D. NMOS管和PMOS管

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22. 5. CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。

A. 微功耗

B. 高速度

C. 高抗干扰能力

D. 电源范围宽

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23. 6. CMOS OD门(漏极开路门)的输出端可以直接相连,实现线与。

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24. 7. CMOS 电路比 TTL 电路功耗大。

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25. 1. 下面逻辑图的输出函数表达式是（ ）。

A.

B.

C.

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26. 2. 下面逻辑图的输出函数表达式是（ ）。

A.

B.

C.

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27. 3. 下面逻辑图的输出函数表达式是（ ）。

A.

B.

C.

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28. 4. 下面逻辑图的输出函数表达式是（ ）。

A.

B.

C.

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29. 1. 下图是（ ）。

A. 半加器

B. 全加器

C. 比较器

D. 同或运算

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30. 2. 下面真值表的电路实现的功能是（ ）。

A. 半加器

B. 全加器

C. 比较器

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31. 3. 下图器件，当输入变量Ai、Bi、Ci-1的取值分别为1、0、1时，（ ）。

A. Si=1, Ci=0

B. Si=1, Ci=1

C. Si=0, Ci=1

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32. 4. 下图电路，当输入变量Ai、Bi的取值分别为1、0时，（ ）。

A.

B.

C.

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33. 1. 下列选项中叙述正确的是（ ）。

A. 普通编码器允许两个以上信息同时输入

B. 优先编码器在任何情况都只对优先级别最高的信息进行编码

C. 优先编码器对优先级别较高的有效输入信息进行编码

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34. 2. 一个键盘上的按键各不相同，共16个按键。对这些信息编码需要（ ）位二进制码。

A. 3

B. 4

C. 5

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35. 3. 下表为8线——三线优先编码器的真值表，相关叙述不正确的是（ ）

A. 输入变量的值为0代表信息有输入，1为信息无输入。

B. 最后一行是对I0编码

C. 优先级别最高的信息是I7

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36. 4. 下面关于8421BCD码优先编码器叙述正确的是（ ）。

A. 输入变量有10个，输出变量有3个。

B. 如果优先级别最高的是I9，则当I9输入1时，一定编码输出为1001

C. 如果I7输入1，一定编码输出0111

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37. 1. 下图为3线—8线译码器，有关叙述正确的是（ ）。

A. 输出变量为1时，代表对输入变量进行译码

B. 当输入变量A2、A1、A0的取值分别为1、0、1时,输出端 ，其它输出1

C. 当使能端都是0时，允许译码。否则禁止工作。

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38. 2. 下图的输出函数表达式是（ ）。

A.

B.

C.

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39. 3. 下图所示为（ ）数码管。

A. 共阳极

B. 共阴极

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40. 4. 下图所示数码管，当a、b、c、d、e、f、g分别接1111001时显示（ ）

A. 1

B. 3

C. 6

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41. 1. 8选1数据选择器74LS151有（ ）位地址变量。

A. 3

B. 4

C. 5

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42. 2. 24选1的数据选择器需要（ ）位地址变量。

A. 3

B. 4

C. 5

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43. 3. 下图的输出函数F的表达式是（ ）。

A.

B.

C.

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44. 4. 下图的输出函数F的表达式是（ ）。

A.

B.

C.

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45. 1. 没有置0功能的触发器是（　　）。

A. ＲＳ－ＦＦ；

B. ＪＫ－ＦＦ；

C. Ｄ－ＦＦ；

D. Ｔ－ＦＦ。

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46. 2. rs触发器的特性方程为

A.

B.

C.

D.

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47. 3. 从结构上看，时序逻辑电路的基本单元是 .

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48. 4. rs触发器的逻辑功能有（ ）（ ）（ ）

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49. 1. JK触发器的特性方程（ ）

A.

B.

C.

D.

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50. 2. JK触发器在CP脉冲的作用下，若要使 ，则输入端必须为（ ）。

A. Ｊ＝Ｋ＝１；

B. Ｊ＝Ｋ＝０；

C. Ｊ＝０，Ｋ＝１；

D. Ｊ＝１，Ｋ＝０。

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51. 3. 图中触发器的初始状态为0，第一个时钟的下降沿后触发器的状态变为（ ）

A. 0

B. 1

C. 不确定

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52. 4. 时序逻辑电路在任一时刻的稳定输出与( )有关。

A. 输入信号

B. 电路原状态

C. 时钟信号

D. 其余选项均不是

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53. 5. 同一时钟CLK控制各触发器的计数器称为异步计数器。

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54. 1. 某计数器的输出波形如图所示，该计数器是（ ）进制计数器。

A. 模6计数器

B. 模7计数器

C. 模8计数器

D. 模16计数器

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55. 2. 观察如图所示，此电路是（　）

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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56. 3. 已知集成4位二进制同步加法计数器74LS161的状态表（左）和构成的N进制计数器（右），该N进制计数器的模值为（ ）

A. 5

B. 6

C. 10

D. 11

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57. 4. 已知集成4位二进制同步加法计数器74LS163的状态表（左）和构成的N进制计数器（右），该N进制计数器的模值为（ ）

A. 5

B. 6

C. 10

D. 11

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58. 1. 观察采用上升沿触发的 T ¢ 触发器电路如图所示，此电路是（　）

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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59. 2. 观察如图所示，此电路是（　）

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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60. 3. 如下图所示是集成异步二－五－十进制计数器，用它构成8421码十进制计数器时，需使（ ）。

A.

B.

C.

D.

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61. 4. 已知集成4位十进制异步加法计数器74290的状态表（左）和构成的N进制计数器（右），该N进制计数器的模值为（ ）

A. 5

B. 6

C. 8

D. 11

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62. 1. 设计一个模10的计数器，至少需要（ ）个触发器。

A. 4

B. 5

C. 6

D. 11

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63. 2. 两片中规模集成电路10进制计数器串联后，最大计数容量为（ ）位。

A. 10

B. 60

C. 100

D. 160

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64. 3. 已知集成4位二进制同步加法计数器74LS163的状态表如下： 试判断用4位二进制计数器 74163同步清零构成十五进制计数器为（ ）。

A.

B.

C.

D.

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65. 4. 已知集成4位二进制同步加法计数器74LS163的状态表如下： 试判断下图构成的计数器为（ ）。

A. 10

B. 60

C. 100

D. 256

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66. 1. 一个4位二进制同步加法计数器用作分频器时，若计数脉冲的频率为，现需要20KHZ的信号，取自（ ）。

A.

B.

C.

D.

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67. 2. 已知集成4位二进制同步加法计数器74LS163的状态表如下： 若用74163同步清零构成300进制计数器，需要（ ）片74163。

A. 1

B. 2

C. 3

D. 4

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68. 3. 已知集成4位十进制异步加法计数器74290的状态表，设计60进制计数器为（ ）

A.

B.

C.

D.

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69. 1. 用N位移位寄存器构成的扭环形计数器的模是

A. N

B. 2N

C. 4

D. 8

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70. 2. 扭环形计数器的特点是

A. 有效环中任一状态下只有一级触发器为1

B. 有效环中任一状态下只有一级触发器为0

C. 有效循环中，从任一状态转到下一个状态时，只有一级触发器翻转。

D. 有效循环中，从任一状态转到下一个状态时，只有一级触发器不翻转。

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71. 3. 4位双向移位寄存器74LS194的状态表如下。则当Q0、Q1、Q2和Q3的现态为1010时，使，控制端M1=0,M0=1，串行输入端DIR=0,DIL=1，并行输入端为全0，一个时钟CP的上升沿过后，输出的状态为（ ）

A. 保持不变

B. 0101

C. 1000

D. 1101

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72. 4. 4位双向移位寄存器74LS194的状态表如下。电路首先给一个5个时钟周期长度的低电平的启动信号，10个时钟CP的上升沿过后，输出的状态转换图为（ ）

A.

B.

C.

D.

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73. 1. 某DAC电路参考电压=4.096V，输入数字量D7...D0＝10101010。则转出电压是（ ）V？

A. 2.71

B. 2.72

C. 2.73

D. 2.74

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74. 2. DAC的R-2R网络中各支路电流之间的规律是后一支路为前一支路的（ ）。

A. 1/5

B. 1/4

C. 1/3

D. 1/2

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75. 3. 模/数转换器的英文简称是（ ）

A. DAC

B. ACD

C. ADC

D. DCA

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76. 4. DAC的R-2R网络送出的电流通过（ ）负反馈放大器转换为电压。

A. 电压串联

B. 电压并联

C. 电流串联

D. 电流并联

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77. 1. 4位DAC的分辨率是满量程的（ ）。

A. 1/14

B. 1/15

C. 1/16

D. 1/17

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78. 2. 要想送出正电压，DAC的参考电压的极性应该为（ ）。

A. 负

B. 正

C. 可正可负

D. 双极性

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79. 3. DAC的建立时间比转换时间（ ）。

A. 相等

B. 长

C. 短

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80. 4. DAC转换误差的量纲通常是（ ）。

A. 伏

B. 毫伏

C. 百分比

D. LSB

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81. 1. 下图中异或门是（ ）。

A.

B.

C.

D.

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82. 2. 已知三变量逻辑函数Y=。则其反函数=（ ）

A.

B.

C.

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83. 3. 下列异或运算结果正确的是（ ）。

A.

B.

C.

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84. 4. 下面选项中有一个不是逻辑项的相邻项，请选择（ ）

A.

B.

C.

D.

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85. 5. 逻辑表达式 （ ）

A.

B.

C.

D.

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86. 1. 设计一个监视交通信号灯工作状态的逻辑电路。正常情况下，红、黄、绿灯只有一个亮，否则发出报警信号。这个逻辑问题中涉及到的输入变量和输出变量分别有几个，代表什么，选择（ ）。

A. 三个输入变量，分别表示每种灯。一个输出变量，代表报警信号

B. 三个输入变量，分别表示每种灯的状态。一个输出变量，代表是否发出报警信号

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87. 2. 四个人就采购某药品事宜进行表决，多数人同意则通过，否则不通过。设计这个表决电路，输入变量的取值有（ ）组。

A. 16

B. 8

C. 20

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88. 3. 三个人就采购某设备事宜进行表决，多数人同意则通过，否则不通过。但是，其中一人有一票否决权。设计这个表决电路，真值表是（ ）。

A.

B.

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89. 4. 三个人就采购某设备事宜进行表决，多数人同意则通过，否则不通过。但是，其中一人有一票否决权。设计这个表决电路，输出函数表达式是（ ）。

A. F=AB+BC+AC

B. F=BC+A

C. F=AB+AC

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90. 1. 模拟量在转换为数字量前必须进行（ ）滤波。

A. 带通

B. 高通

C. 抗混叠

D. 抗纹波

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91. 2. 10位逐次逼近型A／D 转换器而言，若参考电压=4.096V，当vI＝1.003V时输出的二进制数D9...D0＝（ ）。

A. 0011111100

B. 0010111101

C. 0011111010

D. 0010111110

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92. 3. 采样速率(Sample Rate)一般比转换速率（ ）。

A. 快

B. 慢

C. 相等

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93. 4. 从性能角度看，转换速率最快的ADC是（ ）。

A. 并联比较型

B. 逐次比较型

C. 双积分型

D. Σ-Δ型

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94. 1. 常见的开关元件有（ ）（ ）（ ）

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95. 2. 二极管正向偏置时模拟开关（ ），二极管反向偏置时模拟开关（ ）。

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96. 3. 半导体三极管的三个工作区域分别是：（ ）（ ）（ ），用来模拟开关的是哪两个工作区域（ ）（ ）。

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97. 4. cmos管的三个工作区域分别是：（ ）（ ）（ ），用来模拟开关的是哪两个工作区域（ ）。

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98. 1. 下图所示逻辑电路为( )。

A. “与非”门

B. “与”门

C. “或”门

D. “或非”门

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99. 2. TTL逻辑电路是以( )为基础的集成电路

A. 三极管

B. 二极管

C. 场效应管

D. 晶闸管

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100. 3. 以下TTL电路的输出为：（ ），其中输入端所接电阻大小为100k。（请填阿拉伯数字）

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101. 4. 如图所示TTL 反相器，输入电压为0V时，T3（ ）。（填截止或导通）

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102. 5. CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。

A. 微功耗

B. 高速度

C. 高抗干扰能力

D. 电源范围宽

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103. 1. 用卡诺图法求F（A, B, C, D）＝∑m（0, 2, 5, 7, 8, 10, 13, 15）的最简与或式是( )。

A.

B.

C.

D.

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104. 2. 用卡诺图化简函数为最简单的与或式是( )。

A.

B.

C.

D.

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105. 3. 用卡诺图化简函数为最简单的与或式是( )。

A.

B.

C.

D.

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106. 4. 用卡诺图化简逻辑式，化 简 后 为( )。

A.

B.

C.

D.

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