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中国大学MOOC数字逻辑-2024秋作业答案

数字逻辑-2024秋

学校: 无

平台: 超星学习通

题目如下：

1. 组合逻辑电路的输出与输入关系不可用（）描述。

A. Verilog HDL语句

B. 波形图

C. 状态图

D. 卡诺图

答案: 状态图

2. 十进制数33的8421BCD码为（ ）。

A. 00110011

B. 11001100

C. 011011

D. 01100110

答案: 00110011

3. 能实现1位二进制数带进位加法运算的是（ ）。

A. 运算器

B. 半加器

C. 全加器

D. 加法器

答案: 全加器

4. BCD码1001 0001 0010对应的十进制数是（）

A. 2322

B. 912

答案: 912

5. 组合逻辑电路通常由（）组合而成

A. 触发器

B. 寄存器

C. 门电路

D. 计数器

答案: 门电路

6. a1,a2,a3,a4是四位二进制码，若电路采用奇校验，则校验位P的逻辑表达式为（）。

A. a1⊕a2⊕a3⊕a4⊕1

B. a1a2a3a4+1

C. a1⊕a2⊕a3⊕a4⊕0

D. a1+a2+a3+a4+1

答案: a1⊕a2⊕a3⊕a4⊕1

7. 已知下图编码变换电路，其中A3-A0和B3-B0是2个4位的输入端，S3-S0是4位输出端, Ci是进位输入端，Co是进位输出端。若接到输入端A3-A0的信号b3-b0为8421BCD码，说明电路输出端S3-S0的信号是什么编码？

A. 格雷码

B. 5421码

C. 余3码

D. 2421码

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8. 行波进位加法器的进位信号采用（）传递，而并行加法器的进位信号采用（）传递。

A. 超前，超前

B. 逐位，超前

C. 超前，逐位

D. 逐位，逐位

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9. 逻辑函数对应的电路，当变量的取值为（）时，将出现竞争冒险现象。

A. A=0, B=0

B. A=1, C=0

C. B=C=0

D. B=C=1

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10. 下图所示电路的逻辑功能是( )。

A. 选择器（三选一）

B. 一致性表决（当输入完全一致时，输出为“1”）

C. 算术加法（三个1位二进制数相加求和）

D. 多数表决（三人多数表决）

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11. 求出下列2的补码的十进制值 0111011110 （第1空） 1011100111 （第2空）

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12. 判断下列8位2的补码数运算是否有溢出 （ 第1空 ）（填 有 或无） ( 第2空 ) （填 有 或无）

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13. 求出下列无符号数的十进制值 (1011100111)2 （第1空） (3751)8 （第2空） (A25F)16 （第3空）

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14. 35的8位补码为( )。

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15. -78的8位补码为

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16. 从电路结构上来说，译码器和分配器是同一种器件。该描述是否正确（）

A. 错误

B. 正确

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17. 以下Verilog代码描述的是（）。 module Func_ex1 (W, En, Y); input [1:0]W; input En; output reg [0:3] Y; always @(W, En) case ({En,W}) 3'b100: Y = 4'b1000; 3'b101: Y = 4'b0100; 3'b110: Y = 4'b0010; 3'b111: Y = 4'b0001; default: Y = 4'b0000; endcase endmodule

A. 译码器

B. 数码驱动器

C. 编码器

D. 选择器

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18. 低电平译码器可以配合（）实现逻辑函数。

A. 或非门

B. 或门

C. 与门

D. 与非门

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19. 下列数字电路中不是组合逻辑电路的是( )。

A. 计数器

B. 多路选择器

C. 译码器

D. 编码器

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20. 用2选1多路选择器实现如下逻辑函数，正确的是（）。

A.

B.

C.

D.

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21. 函数对w2的香农展开式是（）。

A.

B.

C.

D.

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22. 用译码器实现函数f(w1,w2,w3)=∑m(0,2,5,7)正确的是（）

A.

B.

C.

D.

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23. 实现多输入、单输出逻辑函数, 应选( )。

A. 多路选择器

B. 译码器

C. 编码器

D. 数据分配器

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24. 以下二进制码1010110，需要作偶校验，则增加的偶校验位应为( )

A. 1

B. 3

C. 2

D. 0

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25. 以下Verilog代码描述的是（）。 module Func_ex2 (W, S, f); input [0:3] W; input [1:0] S; output reg f; always @(W, S) case (S) 0: f = W[0]; 1: f = W[1]; 2: f = W[2]; 3: f = W[3]; endcase endmodule

A. 1-4分配器

B. 4-1选择器

C. 2-4译码器

D. 4-2编码器

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26. 二进制数1010110的典型格雷码是（）

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27. 用选择器实现逻辑函数，通常的方法有（）

A. 公式法（表达式比较）

B. 卡诺图法

C. 香农定理展开

D. 真值表法

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28. 以下电路模块是一个3位二进制计数器，其中Load是同步加载信号。如下连接实现了一个（）计数器。

A. 六进制，计数范围1~6

B. 四进制，计数范围0~3

C. 六进制，计数范围0~5

D. 五进制，计数范围1~5

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29. 对于T触发器，若现态Q(t)= 1，要使次态Q(t+1)=0,则输入T=( )。

A. T=0

B. T=1

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30. 在Verilog HDL中，假设时钟信号是Clock，描述该时钟上升沿的正确方式是（）。

A. negedge Clock

B. posedge clock

C. posedge Clock

D. negedge clock

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31. 请选择正确选项填入（空）中补充完成低电平有效的异步清零输入（Resetn）的T触发器的Verilog代码。 module tflflipflflop (T, Clock, Resetn, Q); input T, Clock, Resetn; output reg Q; always @(（空）, posedge Clock) if (!Resetn) Q <= 0; else if (T) Q <= ~Q; endmodule

A. posedge Resetn

B. !Resetn

C. Resetn

D. negedge Resetn

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32. 阅读如下Verilog HDL代码，请问功能描述正确的是（）。 module seq_device (R, Clock, L, E, up_down, Q); parameter n = 8; input [n-1:0] R; input Clock, L, E, up_down; output reg [n-1:0] Q; always @(posedge Clock) if (L) Q <= R; else if (E) Q <= Q + (up_down ? 1 : -1); endmodule

A. 移位寄存器

B. 可逆计数器

C. 递增计数器

D. 递减计数器

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33. 以下触发器Q端的工作波形正确的是（）。

A. Qa

B. Qc

C. 均不正确

D. Qb

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34. 以下器件不是存储元件的是（）。

A. 触发器

B. 寄存器

C. 计数器

D. 数据选择器

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35. 已知有一个4位二进制递增计数器，具有同步预置端Preset、异步清零端Clear和进位输出Co，现在欲设计一个计数状态从0到8的九进制计数器，请问正确的是（）。

A. 采用反馈清零法，从状态8反馈

B. 采用反馈置数法，从状态9反馈

C. 采用反馈置数法，用进位输出Co反馈

D. 采用反馈清零法，从状态9反馈

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36. 设计同步时序逻辑电路时，若有6个状态，至少需要选用( )个触发器。

A. 4

B. 1

C. 2

D. 3

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37. 对于D触发器，若现态Q(t)= 0，要使次态Q(t+1)=0,则输入D=( )。

A. D=x

B. D=1

C. D=0

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38. 阅读如下Verilog HDL代码，请问有关描述错误的是（）。 module flipflop (D, Clock, Resetn, Q); input D, Clock, Resetn; output reg Q; always @(negedge Resetn, negedge Clock) if (!Resetn) Q <= 0; else Q <= D; endmodule

A. 描述了一个D触发器

B. 该器件采用下降沿触发

C. 该器件采用异步清零方式

D. 该器件采用同步清零方式

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39. 以下触发器的时钟触发机制是（）。

A. 低电平触发

B. 高电平触发

C. 下降沿触发

D. 上升沿触发

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40. 以下触发器的时钟触发机制是（）。

A. 下降沿触发

B. 高电平触发

C. 低电平触发

D. 上升沿触发

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41. 在Verilog HDL中，非阻塞赋值的运算符是（）。

A. :=

B. <=

C. ==

D. =

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42. 在同步方式下，JK触发器的现态为0，要使次态为1，则应使（）。

A. J=0, K=d

B. J=K=0

C. J=1, K=d

D. J=d，K=0

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43. 以下电路模块是一个3位二进制计数器，其中Load是异步加载信号。如下连接实现了一个（）计数器。

A. 六进制，计数范围0~5

B. 六进制，计数范围1~6

C. 五进制，计数范围0~4

D. 四进制，计数范围0~3

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44. 同步时序逻辑电路是指电路中（）。

A. 所有触发器的类型相同

B. 所有触发器的时钟信号相同

C. 所有触发器的类型均不同

D. 所有触发器的时钟均不同

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45. 与Moore型时序电路比较，Mealy型时序电路的特点是（）。

A. 没有输入信号

B. 没有输出信号

C. 输出不仅与电路状态有关，也和输入信号有关

D. 输出只和电路的状态有关，和输入信号无关

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46. 以下状态机（是/否）具有自启动能力。

A. 不确定

B. 否

C. 是

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47. 下表所示的原始状态表化简后具有（）个状态。

A. 4

B. 3

C. 5

D. 6

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48. 分析下图所示的电路，该电路可以检测w上的输入序列为（）。

A. 连续输入3,5,7,9...等奇数个1

B. 111

C. 1111

D. 连续输入2,4,6,8...等偶数个1

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49. 以下状态机是（）。

A. 0000序列检测器

B. 4进制可逆计数器

C. 4进制递增计数器

D. 1111序列检测器

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50. 分析图示电路，该电路是（）。

A. 异步时序电路

B. 组合逻辑电路

C. Mealy型时序电路

D. Moore型时序电路

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51. 下列器件中不是时序电路的是（）。

A. 序列检测器

B. 移位寄存器

C. 加法状态机

D. 快速加法器

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52. 如图所示的电路，若输入时钟Clock的频率为100KHz，则输出Q的频率为（）。

A. 400KHz

B. 50KHz

C. 200KHz

D. 100KHz

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53. 下面时序电路图中输出函数为（ ）。

A.

B.

C.

D.

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54. 在某计数器的输出端观察到如图所示的波形，则该计数器的模是（）。

A. 8

B. 7

C. 9

D. 6

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55. 下图所示电路的时序图（或称波形图）是（）。

A.

B.

C.

D.

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56. 连续异或2019个1的结果是（）。

A. 逻辑概念错误

B. 0

C. 1

D. 不确定

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57. 已知逻辑函数，与它功能相等的函数表达式（）。

A. F=AB+C

B.

C. F=AB

D.

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58. 逻辑函数化简的结果是（）。

A. AB

B. B

C. A+B

D. 1

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59. 全体最小项之和等于（ ）。

A. -1

B. 未知

C. 1

D. 0

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60. 下列时序图对应的最简积之和形式为（）。

A. x1 ~x2 + ~x2 ~x3 + x1 x2

B. ~x1 ~x2 + ~x2 x3 + x1 x2

C. ~x1 ~x2 + ~x2 ~x3 + x1 ~x2

D. ~x1 ~x2 + ~x2 ~x3 + x1 x2

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61. 设mi和mj是n个变量构成的两个最小项，若i≠j则（）。

A. mi·mj = 0

B. mi·mj = 1

C. mi+ mj = 1

D. mi+ mj = 0

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62. 如果一个最小项不出现在原函数中，就一定会出现在该函数的反函数中。请判断（）。

A. 正确

B. 错误

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63. 三态门的输出不会出现（ ）。

A. 高阻态

B. 0

C. 低阻态

D. 1

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64. 以下三变量卡诺图为了得到最优覆盖，则需画几个卡诺圈？每个圈包含几个最小项？

A. 3个卡诺圈，分别包含1个、1个、4个最小项

B. 2个卡诺圈，均包含4个最小项

C. 2个卡诺圈，分别包含2个、4个最小项

D. 3个卡诺圈，均包含2个最小项

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65. 仓库门上装了两把暗锁，A、B两位保管员各管一把锁的钥匙，必须二人同时开锁才能进库。这种逻辑关系为（ ）。

A. 与非

B. 异或

C. 或

D. 与

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66. 以下卡诺图画圈正确的是（）

A.

B.

C.

D.

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67. 按教材中的定义，下列电路的成本为（）。

A. 12

B. 10

C. 11

D. 9

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68. 在逻辑函数F=AB+CD的真值表中，F=1的状态有（）个。

A. 4

B. 7

C. 2

D. 6

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69. 设计一个电路，该电路的输入为 x1,x0,y1,y0,输出为 f 。令 X=x1x0 、Y=y1y0均为一个有 4 种可能取值的数字，即 00,01,10 和 11，分别表示 0,1,2,3 四个数。若 X = Y，则输出f值为1，否则f值为 0。则 f 的最简单的和之积（POS）表达式为（）。

A. (~x0~y0 + x0 y0)(~x1~y1 + x1 y1)

B. (~x0~y1 + x1 y0)(~x1~y0 + x0 y1)

C. (~x0 + y0)(x0 + ~y0)(~x1 + y1)(x1 + ~y1)

D. (~x0 + y1)(x0 + ~y1)(~x1 + y0)(x1 + ~y0)

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70. 根据以下真值表直接写出的函数f表达式为（ ）。

A. x2 ∙ x3 + x1 ∙ x2

B. ~x2 ∙ ~x3 + ~x1 ∙ ~x2

C. x1 ∙ ~x2 ∙ ~x3 + ~x1 ∙ ~x2 ∙ x3

D. ~x1 ∙ x2 ∙ x3 + x1 ∙ x2 ∙ ~x3

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71. 用公式法化简以下函数，化简结果为F=（）

A.

B.

C.

D.

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72. 根据以下真值表写出的函数f的正则SOP（标准与或）表达式中包含的最小项有f=∑m（ ）。

A. m2

B. m0

C. m1

D. m9

E. m5

F. m4

G. m8

H. m3

I. m6

J. m7

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73. 以下四变量卡诺图的表达式可以写成形如F(A,B,C,D)=Σm(1,3,6,9) + Σd( ? )，其中无关项包含哪些（）【填写数字】

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