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中国大学MOOC数字电子技术基础24-25-2作业答案

数字电子技术基础24-25-2

学校: 九八五题库

学校: 超星学习通

题目如下：

1. 1. 作业或出勤超过（）比例，会被取消考试资格。

A. 1/2

B. 1/3

C. 1/4

D. 1/5

答案: 1/3

2. 2. 作业的要求中，有（）条规则。

A. 5

B. 6

C. 7

D. 8

答案: 8

3. 3. 本门课程成绩包含（）。

A. 平时成绩

B. 实验成绩

C. 实践成绩

D. 考试成绩

答案: 平时成绩# 考试成绩

4. 4. 我的办公室在（）。

答案: HL-423

5. 1. 在某一进位制的数中，每一位的大小都对应着该位上的数码乘上一个固定的数，这个固定的数就是这一位的（ ）。

答案: 权数

6. 2. 在进位制中可能用到的数码个数叫做（）。

答案: 基数

7. 3. F27H转化为十进制数为（），对应的二进制为（），对应的八进制为（）。

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8. 4. 365D对应的8421码为（）。

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9. 5. -102D的源码是（），反码是（），补码是（）。

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10. 6. 十进制数29转换为余3码为（）。

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11. 1. A、B为逻辑门的2个端入端,Y 为输出。A、B和Y 的波形如图所示,则该门电路执行的是( )逻辑操作。

A. 与

B. 与非

C. 或

D. 或非

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12. 2. 以下代码中为恒权码的是( )。

A. 余3循环码

B. 5211码

C. 余3码

D. 格雷码

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13. 3. 对偶规则和反演规则比较，唯一的不同是（）。

A. 变量保持不变

B. 变量全部取反

C. 所有的1换成0，0换成1

D. 所有的与换成或、或换成与

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14. 4. 逻辑函数的表示方法中不具有唯一性的是( )。

A. 真值表

B. 表达式

C. 逻辑图

D. 卡诺图

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15. 5. 十进制数(9)10比十六进制数(9)16小。

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16. 6. 十进制数(20)10比十六进制数(20)16小。

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17. 7. (01001101.10011100)2=( )16

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18. 8. (83)10=( )8421BCD=( )余3BCD

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19. 9. (10110010.1011)2=( )8=( )16

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20. 10. 利用卡诺图化简法化简逻辑函数时,两个相邻项合并,消去一个变量,四个相邻项合并,消去( )个变量等。一般来说,2n个相邻一方格合并时,可消去( )个变量。

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21. 11. 逻辑函数F=B'D'的反函数F'=( )。(最简与或形式)

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22. 1. 下列编码中属于互斥代码的有（）。

A. 000000100

B. 111101101

C. 011111111

D. 0000011111

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23. 2. 74HC138在（）情况下不能工作。

A.

B.

C.

D.

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24. 3. 把具有特定意义信息的二进制代码翻译出来的过程称为（）。

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25. 4. 二进制译码器的通项公式是（ ）。

A.

B.

C.

D.

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26. 5. 在将多片译码器进行级联时，要求所有的芯片（）。

A. 至少有一个芯片工作

B. 分时工作

C. 要求一个及一个以上的芯片同时工作

D. 几个芯片同时工作都可以

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27. 1. 数据分配器可以使用（）实现。

A. 二进制编码器

B. 二进制译码器

C. 数据选择器

D. 数值比较器

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28. 1. 四二输入异或门的含义是（）。

A. 一个芯片中有一个四输入异或门和一个二输入异或门

B. 一个芯片中有两个四输入的异或门

C. 一个芯片中有四个两输入的异或门

D. 四二是指芯片的型号

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29. 2. 同时实现逻辑函数AB和ABC，最少需要3个异或门。

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30. 1. 把输入的每一个高、低电平信号编成一个对应的二进制代码，这样的逻辑器件称为（ ）。

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31. 2. 允许输入两个以上编码信号，当输入有一个以上信号申请编码时，只对优先级别最高的信号进行编码，这样的编码器称为（ ）。

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32. 3. 优先编码器级联的核心思想是（）。

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33. 4. 按输出代码的不同，编码器可分为二进制编码器和BCD码编码器两种。

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34. 5. 按照功能的不同，编码器可分为普通编码器和优先编码器两种。

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35. 6. 已知真值表如下，则输出Y=( )。

A.

B.

C.

D.

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36. 7. 在优先编码器74LS148中，当芯片工作但没有输入有效的低电平信号时有（）。

A. EI’=1；

B. EI’=0；

C. EO=1；

D. GS'=0

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37. 8. 在优先编码器74LS148中，当芯片工作且有有效的低电平输入信号时有（）。

A. EI‘=1；

B. EO=1;

C. GS'=1;

D. EI'和EO，只要一个是0一个是1就可以；

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38. 9. 在组合逻辑电路中，用于产生高低电平的器件有（ ）。

A. 单刀单掷开关

B. 单刀双掷开关

C. 自锁开关

D. 非自锁按键开关

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39. 1. 一个N选一数据选择器，不辅助其它门电路的情况下，可以实现最多（）变量的逻辑函数。

A. N

B. N-1

C.

D.

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40. 2. 一个N个地址端的数据选择器，不辅助其它门电路的情况下，可以实现最多（）变量的逻辑函数。

A. N

B. N+1

C.

D.

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41. 3. 一个N变量的逻辑函数，在不辅助其它门电路的情况下，至少需要（）个地址端的数据选择器才可以实现。

A. N

B. N-1

C. N+1

D.

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42. 4. 一个N变量的逻辑函数，在不辅助其它门电路的情况下，至少需要（）选一的数据选择器才可以实现。

A. N

B. N-1

C.

D.

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43. 1. （ ）是各种触发器电路中结构形式最简单的一种，也是各种触发器电路的基本组成部分。

A. SR锁存器

B. SR触发器

C. JK触发器

D. D触发器

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44. 2. 触发器电路与门电路相比较，最明显的特点是触发器具有（）特性。

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45. 3. 在触发器中，输入S=1、R=0，代表触发器的S输入引脚永远为高电平，R输入引脚永远为低电平。

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46. 4. Q*和Q是同一个输出引脚，所以它们两个的值永远都是相同的。

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47. 5. 在触发器中，Q是Q*的初态，Q*是Q的次态。

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48. 6. 两个或非门形成触发器具备记忆特性，是因为电路形成了反馈。

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49. 7. 用或非门形成的SR锁存器和用与非门形成的SR锁存器功能相同，只是输入信号的有效电平不一样。

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50. 8. SR锁存器可以消除按键的抖动。

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51. 9. SR锁存器具有如下（）功能。

A. 保持

B. 置1

C. 置0

D. 翻转

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52. 1. 由于采用的电路结构形式不同，触发信号的触发方式也不一样，触发方式分为（）、（）和（）三种。

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53. 2. 根据触发器的逻辑功能的不同分为（）、（）、（）、（）等几种类型。

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54. 3. 因为电平触发的SR触发器是在SR锁存器的基础上又增加了一级门电路，所以它不需要遵守SR=0的约束条件。

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55. 4. 电平触发的SR触发器在S=R=1、CLK由1回到0时，输出状态不定。

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56. 5. 电平触发的SR触发器在CLK=1时，只要S=R=1输出状态就不定。

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57. 6. 电平触发的SR触发器在CLK=1、S=R=1时，只要S或R有一个先消失，输出状态就不定。

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58. 7. 电平触发的SR触发器具有很强的抗干扰能力，输入信号受到干扰时，输出信号不会发生改变。

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59. 8. 只要将电平触发的SR触发器的S端接D、R端接D‘，就能构成电平触发的D触发器。

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60. 9. 电平触发的D触发器虽然是用SR锁存器为核心构成的，但是它使用时没有约束条件限制。

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61. 10. 电平触发的SR触发器具有（）功能。

A. 置1

B. 置0

C. 保持

D. 翻转

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62. 1. 能对两个1位二进制数进行相加而求得和及进位的逻辑电路称为半加器，它没有考虑来自低位的进位。

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63. 2. 能对两个1位二进制数进行相加并考虑低位来的进位，即相当于3个1位二进制数相加，求得和及进位的逻辑电路称为全加器。

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64. 3. 实现多位二进制数相加的电路称为加法器。

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65. 4. 加法器分为串行进位加法器和并行进位加法器。

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66. 5. 按照进位产生的条件可分为两种，一种是进位（）条件，一种是进位（）条件。

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67. 6. 属于超前进位加法器的集成芯片有（）。

A. 74183

B. 74LS283

C. 74HC283

D. 74LS138

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68. 1. 下列计数器中，具有异步清零端的计数器是（）

A. 74LS160

B. 74LS161

C. 74LS162

D. 74LS163

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69. 2. 下列计数器中，具有同步置数端的计数器是（）

A. 74LS160

B. 74LS161

C. 74LS162

D. 74LS163

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70. 3. 下列计数器中，属于四位二进制（16进制）计数器的是（ ）。

A. 74LS160

B. 74LS161

C. 74LS162

D. 74LS163

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71. 4. 按计数器中的触发器是否同时翻转分类，可分为（）计数器和（）计数器。

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72. 5. 74LS160~74LS163四种计数器的共同特点是它们都是（）（填同步、异步）加法计数器。

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73. 6. 按计数过程中计数器的数字增减分类，又可把计数器分为（）计数器、（）计数器和（）计数器(或称加/减计数器)。

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74. 7. 按（）来区分，计数器可分为十进制计数器、六十进制计数器等。

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75. 8. 74LS160~74LS163四个芯片的引脚排列图都相同，都是上升沿触发的同步可逆计数器。

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76. 1. 在求解清零或置数的逻辑时，要求这个逻辑必须具有（）性，才能得到正确的M进制计数器。

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77. 2. 利用芯片本身的进位或借位输出端产生置零或置数逻辑实现M进制计数器的方法，适合实现（）计数器。

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78. 3. 在实现任意进制计数器时，若同步和异步的清零或置数方式均可实现，则优先选用（）步形式。

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79. 4. 在利用异步清零端实现清零逻辑时，计数器的数据输入端可以什么都不接。

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80. 5. 利用异步信号和同步信号实现置零或置数逻辑时，对计数器来说区别只在于是用一个有效状态译出还是一个额外的短暂状态实现。

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81. 6. 一个计数器中有效循环状态有多少个就是多少进制的计数器。

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82. 7. 利用异步引脚实现M进制计数器时，若计数器内部触发器复位或置位的速度不一致，导致电路发生误操作，则可以采用锁存器增加电路复位或置位的时间解决。

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83. 1. 边沿触发的触发器在三种触发方式的触发器中具有最好的抗干扰能力，因为边沿触发器的次态仅取决于CLK信号的上升沿↑或下降沿↓到达时刻输入信号的状态。

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84. 2. 在边沿触发的触发器中，既有边沿JK触发器，也有边沿D触发器。

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85. 3. 在边沿触发器的符号中，“>”代表上升沿触发，“<”代表下降沿触发。

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86. 4. 异步输入引脚是指受时钟信号控制的引脚，同步输入引脚是指不受时钟信号控制的引脚。

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87. 1. 凡在时钟信号作用下逻辑功能符合下表所规定的逻辑功能者，无论触发方式如何，均称为SR触发器。所以SR锁存器也属于SR触发器。

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88. 2. ,且SR=0，称为SR触发器的（ ）。

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89. 3. 在描述触发器的逻辑功能时可以用（）、（）和（）三种方法。

A. 特性表

B. 特性方程

C. 状态转换图

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90. 4. 具有保持和翻转功能的触发器有（）触发器。

A. JK

B. T

C. T’

D. D

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91. 5. JK触发器的特性方程是（）

A.

B.

C.

D.

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92. 6. T触发器的特性方程是（）

A.

B.

C. Q

D. Q

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93. 7. 能直接将时钟信号进行2分频的触发器是（）触发器

A. JK

B. SR

C. D

D. T‘

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94. 8. 只具有保持和翻转功能的触发器有（）触发器。

A. JK

B. T

C. T‘

D. D

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95. 9. 只具有置1和置0功能的触发器有（）触发器。

A. JK

B. T

C. T‘

D. D

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96. 1. 关于集成D触发器74LS175的说法正确的是( )。

A. 双D触发器

B. 四D触发器

C. 具有异步清零端和置位端

D. 只具有异步清零端，且低电平有效

E. 上升沿触发的D触发器

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97. 2. 就触发方式而言，74LS175是（）的触发器。

A. 电平触发

B. 脉冲触发

C. 边沿触发

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98. 1. 在集成产品系列里一般只有（）触发器。

A. SR

B. JK

C. D

D. T

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99. 2. 不同触发器之间的转换方法：就是利用令已有触发器和待求触发器的( )相等的原则，求出转换逻辑。

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100. 1. 数字逻辑电路分为（）逻辑电路和（）逻辑电路。

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101. 2. 由组合逻辑电路和触发器组成的是（）逻辑电路。

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102. 3. 组合逻辑电路与时序逻辑电路的主要区别是时序逻辑电路有（）。微观上讲就是时序逻辑电路结构上具有（）。

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103. 4. 时序电路在任何时刻的稳定输出，不仅与该时刻的（）信号有关，而且还与电路原来的（）有关。

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104. 5. 时序逻辑电路根据时钟分类，分为（）时序逻辑电路和（）时序逻辑电路。

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105. 6. （）型时序电路的输出不仅与存储电路的状态Q有关，而且还决定于电路当前的输入X。

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106. 7. （）型时序电路的输出仅决定于存储电路的状态Q。

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107. 8. 驱动方程就是触发器的（）端所对应的方程。

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108. 9. 分析时序逻辑电路所用的三大方程称为（）方程、（）方程和（）方程。

A. 驱动方程

B. 状态方程

C. 特性方程

D. 输出方程

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109. 10. 描述时序逻辑电路的方法有（）。

A. 特性方程

B. 驱动方程

C. 状态方程

D. 输出方程

E. 状态转换图

F. 状态转换表

G. 时序表

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110. 1. 原始状态图中，凡是在相同的（）下有相同的（），且转换到相同的（）去，称这两个状态为等价状态。

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111. 2. 在由状态图求JK触发器的驱动方程时，可以跳过状态方程直接求解，方法是在Q=0的区域里圈（）化简即为J，在Q=1的区域里圈（）化简即为K。

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112. 3. 如果要求电路具备自启动，则每一个初态都要有（）的次态。因此要求在输出方程卡诺图和状态卡诺图Q=0的区域里，和1圈在一起的约束项变为（），未圈入的变为（）。在状态卡诺图Q=1的区域里，和0圈在一起的约束项变为（），未圈入的变为（）即可。

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113. 1. 下列计数器中，属于十进制计数器的是（）

A. 74LS190

B. 74LS191

C. 74LS192

D. 74LS193

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114. 2. 下列计数器中，具有异步置数端的计数器是（）

A. 74LS190

B. 74LS191

C. 74LS192

D. 74LS193

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115. 3. 下列计数器中，属于四位二进制（16进制）计数器的是（ ）。

A. 74LS190

B. 74LS191

C. 74LS192

D. 74LS193

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116. 4. 下列计数器中，可实现减法计数器的是（ ）。

A. 74LS190

B. 74LS191

C. 74LS160

D. 74LS161

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117. 5. 74LS190~74LS193四个芯片的引脚排列图都相同，都是上升沿触发的同步可逆计数器。

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118. 6. 利用74LS192和74LS193做加法计数器时，则此时减法时钟应该接（）电平。

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119. 1. 下图所示电路是（）进制的计数器。

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120. 2. 对于实现任意进制计数器的6种方法，只适用于MN的情况。

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121. 1. 通常只能存储一位数据的电路叫做（ ）。

A. 存储单元

B. SR触发器

C. 寄存器

D. 硬盘

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122. 2. 用于存储一组数据的存储电路叫做（）。

A. 触发器

B. 存储单元

C. 寄存器

D. 内存

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123. 3. 用于存储大量数据的存储电路叫做（）。

A. 寄存器

B. 存储单元

C. 运存

D. 存储器

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124. 4. 常用寄存器有两种，一种是寄存并行数据的，称为数据（）；一种是寄存串行数据的，称为（）。

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125. 5. 74HC573是74HC373的改进型，从功能到参数上都进行了改进。

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126. 6. 74HC573和74HC574都是边沿触发型的寄存器，所以两者可以互换。

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127. 7. 在动态数码管显示驱动电路中，可以将74HC573替换成74HC574，并可提高该电路的抗干扰能力。

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128. 1. 移位寄存器74LS194A具有（）功能。

A. 并行输入

B. 左移

C. 右移

D. 保持

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129. 2. 74LS194A的清零引脚是（）的，（）电平有效。

A. 同步

B. 异步

C. 高

D. 低

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130. 3. 74LS194A可以实现的功能电路有（）。

A. 环形计数器

B. 扭环形计数器

C. 奇数分频器

D. 数据串-并转换电路

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131. 4. 移位寄存器74LS194A进行左移操作时，数据从SL端输入，从QD端输出；进行右移操作时，数据从SR端输入，从QA端输出。

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132. 5. 移位寄存器74LS194A进行级联时，左边芯片的QD引脚要与右边芯片的SR连接；右边芯片的QA引脚要与左边芯片的SL连接。

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133. 6. 74LS194A工作在右移方式时，S1S0=（）。

A. 00

B. 01

C. 10

D. 11

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