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中国大学MOOC计算机系统基础作业答案

计算机系统基础

学校: 九八五题库

学校: 超星学习通

题目如下:

1. 1. 下列哪些信号属于数字信号( )。

A. 正弦波信号

B. 时钟脉冲信号

C. 音频信号

D. 视频图像信号

答案: 时钟脉冲信号

2. 2. 数字信号在时间上如何变化,幅度上如何变化?( )。

A. 连续;连续

B. 连续;离散

C. 离散;连续

D. 离散;离散

答案: 离散;离散

3. 3. 表示脉冲电压变化最大值的参数叫( )。

A. 脉冲幅度

B. 脉冲宽度

C. 脉冲前沿

D. 脉冲后沿

答案: 脉冲幅度

4. 4. 表示两个相邻脉冲重复出现的时间间隔的参数叫( )。

A. 脉冲周期

B. 脉冲宽度

C. 脉冲前沿

D. 脉冲后沿

答案: 脉冲周期

5. 5. 将脉冲信号从脉冲前沿的0.5Vm到后沿的0.5Vm所需要的时间为( )。

A. 脉冲周期

B. 脉冲宽度

C. 脉冲前沿

D. 脉冲后沿

答案: 脉冲宽度

6. 1. 以下代码中,为有权码的是( )

A. 奇校验码

B. 5421BCD码

C. 余三码

D. 格雷码

答案: 5421BCD码

7. 2. 奇校验系统中,信息位是(01100101),则加上校验位之后,应该为( )

A. 101100101

B. 011001011

C. 001100101

D. 011001010

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8. 3. 十进制数74转换为8421BCD码应当是( √ )

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9. 1. 在( )的情况下,函数运算的结果是逻辑“1”

A. 全部输入是“0”

B. 任一输入是“0”

C. 任一输入是“1”

D. 全部输入是“1”

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10. 2. 在全部输入是“0”的情况下,函数运算的结果是逻辑“0”。

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11. 3. 逻辑变量取值的0和1表示事物相互独立而又联系的两个方面。

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12. 4. 下列逻辑式中,正确的是( )。

A.

B.

C.

D.

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13. 5. 函数F=AB+BC,使F=1的输入ABC组合为( )。

A. ABC=000

B. ABC=010

C. ABC=001

D. ABC=110

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14. 1. 逻辑函数的卡诺图中,相邻最小项可以合并。

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15. 2. 任何一个函数的真值表是唯一的,但卡诺图不唯一。

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16. 3. 任何一个函数的表达式不唯一,但最简式却是唯一的。

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17. 4. 在卡诺图中几何相邻的最小项一定逻辑相邻,逻辑相邻的最小项也一定几何相邻。

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18. 5. 真值表和卡诺图是一一对应的关系,真值表和逻辑式也是一一对应的关系。

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19. 1. 数字电路中的三极管工作在( )。

A. 饱和区

B. 截止区

C. 饱和区或截止区

D. 放大区

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20. 2. TTL接高电平,不能使用的方法为( )

A. 悬空

B. 通过大电阻接地

C. 通过小电阻接地

D. 通过电阻接电源

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21. 3. 要使TTL或非门变成反相器,多余的输入端( )

A. 和使用端连接在一起

B. 接高电平

C. 通过大电阻接低电平

D. 悬空

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22. 4. 门电路的阈值电压是输入高低电平的分界点。

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23. 5. 半导体二极管因为其有导通、截止两种工作状态,所以可以作为开关元件使用;半导体三极管因为其有饱和、截止、放大三种工作状态,所以其不可以作为开关元件使用。

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24. 1. 输出端可并联使用的TTL门电路是( )。

A. 三态门

B. OC门

C. 与非门

D. 或非门

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25. 2. 下列各门电路中,( )的输出端可直接相连,实现线与。

A. 一般TTL 与非门

B. 集电极开路TTL与非门

C. 一般CMOS与非门

D. 一般TTL或非门

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26. 3. 三态门除了可输出高、低电平外,还有高阻悬浮的第三态。

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27. 4. 扇出系数是指带同类门的个数。

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28. 5. 下列所给三态门中,能实现C=0时,;C=1时,F为高阻态的逻辑功能的是( )。

A.

B.

C.

D.

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29. 1. 下列门电路属于双极型的是( )

A. OC门

B. PMOS

C. NMOS

D. CMOS

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30. 2. 以下电路中常用于总线应用的是( )

A. 三态门

B. OC门

C. 漏极开路门

D. CMOS与非门

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31. 3. 所有系列的TTL门和CMOS门只要逻辑功能相同,在电路中就可以相互替代。

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32. 4. TTL门电路和CMOS门电路相比,具有开关速度高,带负载能力强的优点。

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33. 5. 传输门是用来传输模拟信号的,一般不用来传输数字信号。( )

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34. 1. CMOS门电路的输入端在使用中不允许悬空。

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35. 2. TTL门输入端不能悬空。

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36. 3. CMOS门输入端悬空相当于接了一个高电平。

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37. 4. TTL与非门的多余输入端可以接固定高电平。

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38. 5. 要使CMOS门输入高电平, 可以将通过电阻接地。

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39. 1. 组合逻辑电路的输出取决于( )

A. 输入信号的现态

B. 输出信号的现态

C. 输出信号的下一状态

D. 输入信号的现态和输出信号的现态

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40. 2. 组合逻辑电路( )

A. 具有记忆功能

B. 没有记忆功能

C. 有时有记忆功能,有时没有

D. 以上都不对

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41. 3. 在任何时刻,电路的输出状态只取决于该时刻的输入,而与该时刻之前的电路状态无关的逻辑电路,称为组合逻辑电路。

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42. 1. 对于两个4位二进制数A()、B(),下面说法正确的是( )

A. 如果>,则A>B

B. 如果<,则A>B

C. 如果>,则A>B

D. 如果<,则A>B

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43. 1. 全加器的逻辑功能是( )

A. 两个同位的二进制数相加

B. 两个二进制数相加

C. 两个同位的二进制数及来自低位的进位三者相加

D. 不带进位的两个二进制数相加

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44. 2. 并行(超前)进位加法器的特点是( )。

A. 工作速度快;电路结构复杂

B. 工作速度快;电路结构简单

C. 工作速度慢;电路结构复杂

D. 工作速度慢;电路结构简单

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45. 1. 对于8线—3线优先编码器,下面说法正确的是( )

A. 有3根输入线,8根输出线

B. 有8根输入线,3根输出线

C. 有8根输入线,8根输出线

D. 有3根输入线,3根输出线

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46. 2. 优先编码器只对同时输入的信号中的( )一个信号编码。

A. 优先级别最高的

B. 最低位

C. 最高位

D. 优先级最低的

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47. 3. 编码器在任何时刻只能对一个输入信号进行编码。

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48. 4. 优先编码器的编码信号是相互排斥的,不允许多个编码信号同时有效。

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49. 1. 驱动共阳极七段数码管的译码器的输出电平为( )有效。

A. 低电平

B. 高电平

C. 低电平或者高电平

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50. 2. 3位二进制译码器应有3个输入端和8个输出端。

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51. 3. 下图是共阴极七段LED数码管显示译码器框图,若要显示字符“5”,则译码器输出a~g应为( )。

A. 0100100

B. 1100011

C. 1011011

D. 0011011

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52. 1. 型竞争冒险也称为0型竞争冒险。

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53. 2. 引起组合逻辑电路中竞争与冒险的原因是逻辑关系的错乱。

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54. 3. 引起组合电路中竞争与险象的原因是干扰信号。

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55. 1. 对于触发器和组合逻辑电路,以下( )的说法是正确的。

A. 两者都有记忆能力

B. 两者都无记忆能力

C. 只有组合逻辑电路有记忆能力

D. 只有触发器有记忆能力

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56. 2. 触发器有两个稳定状态,一个是现态,一个是次态。

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57. 3. 由与非门构成的基本RS触发器在输入均为1时,输出状态不确定。

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58. 1. 同步D触发器的Q端和D端的状态在任何时刻都是相同的。

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59. 2. 触发器的逻辑功能可以用真值表、卡诺图、特性方程、状态图和波形图等五种方式描述。

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60. 1. 为避免一次翻转现象,应采用( )触发器。

A. 主从

B. 边沿

C. 同步

D. 基本RS

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61. 2. 边沿D触发器为一种( )触发器。

A. 单稳态

B. 双稳态

C. 无稳态

D. 多稳态

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62. 3. 采用边沿触发器是为了防止空翻。

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63. 4. 边沿控制触发的触发器的触发方式为( )。

A. 上升沿触发

B. 下降沿触发

C. 可以是上升沿触发,也可以是下降沿触发

D. 可以是高电平触发,也可以是低电平触发

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64. 1. 同步时序逻辑电路和异步时序逻辑电路比较,其差异在于后者( B )

A. 没有触发器

B. 没有统一的时钟脉冲控制

C. 没有稳定状态

D. 输出只与内部状态有关

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65. 2. 时序逻辑电路中一定包含( )

A. 触发器

B. 编码器

C. 移位寄存器

D. 译码器

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66. 3. 时序逻辑电路的特点是在任何时刻的输出不仅和输入有关,而且还取决于电路原来的状态。

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67. 4. 同步时序电路和异步时序电路的最主要区别是,前者没有CP脉冲,后者有CP脉冲。

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68. 5. 当时序逻辑电路进入无效状态后,若能自动返回有效工作状态,该电路能自启动。

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69. 1. 若要1000分频,则需要( )片74LS160计数器。

A. 10

B. 4

C. 3

D. 6

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70. 2. 一个5进制计数器和一个8进制计数器串联,可得到13进制计数器。

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71. 1. 如果需要产生“01000100”这样的序列,至少需要( )个存储器。

A. 2

B. 3

C. 4

D. 8

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72. 2. 移位型序列信号发生器的原理与移位寄存器的原理相同。

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73. 1. 下列芯片连接的电路不可能构成序列信号发生器的是( )。

A. 译码器+集成计数器

B. 数据选择器+集成计数器

C. 编码器+计数器

D. 译码器+触发器

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74. 1. 集成555定时器的输出状态有( )

A. 0状态

B. 1状态

C. 0和1状态

D. 高阻态

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75. 2. 用555定时器构成的施密特触发器的回差电压可表示为( )

A.

B.

C.

D.

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76. 1. 自动产生矩形波脉冲信号的为( )

A. 施密特触发器

B. 单稳态触发器

C. T触发器

D. 多谐振荡器

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77. 1. D/A转换器的输出量与输入量一定相等。

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78. 2. 在D/A转换电路中,当输入全部为零时,输出电压等于( )

A. 电源电压

B. 0

C. 基准电压

D. 不确定

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79. 1. 一个无符号10位数字输入的DAC,其输出电平的级数是( )

A. 4

B. 10

C. 1024

D. 100

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80. 2. 倒T型电阻网络D/A转换器中各个电阻的阻值相差很大。

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81. 3. 权电阻网络D/A转换器中位权越大,对应的权电阻值就越小。

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82. 1. 下列几种A/D转换器中,转换速度最快的是 ( )

A. 并行A/D转换器

B. 计数型A/D转换器

C. 逐次渐进型A/D转换器

D. 双积分A/D转换器

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83. 2. 如果某个模拟信号的最高组成频率是20KHz,那么最低的取样频率是10KHz。

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84. 3. A/D转换器抽样后得到的信号是数字信号。

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85. 4. 模拟信号经过采样和保持将信号离散化,再经过编码和量化转换为数字信号。

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86. 5. 将取样电压化为最小数量单位(1LSB)的整数倍的转换过程称为采样。

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87. 1. 集成ADC0809可以锁存( )模拟信号。

A. 9路

B. 8路

C. 10路

D. 16路

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88. 2. 在D/A转换电路中,数字量的位数越多,分辨输出最小电压的能力( )。

A. 越稳定

B. 越弱

C. 越强

D. 不确定

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89. 1. 只能读出不能写入,但信息可永久保存的存储器是( )

A. ROM

B. RAM

C. RPROM

D. PROM

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90. 2. 存储器所存储的二进制信息的总位数称为存储器的存储容量。

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91. 3. 一个具有n根地址输入线和k条输出线的ROM存储容量是( )

A.

B.

C.

D.

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92. 4. 存储器ROM中的内容,当电源断掉后又接通,存储器中的内容( )

A. 全部改变

B. 全部为1

C. 不确定

D. 保持不变

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93. 5. 随机存储器中的内容,当电源断掉后又接通,存储器中的内容( )

A. 全部改变

B. 全部为1

C. 不确定

D. 保持不变

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94. 1. 堆栈存储器的存取方式是( )

A. 先入先出

B. 先入后出

C. 随机

D. 按地址查找

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95. 2. 队列的存取方式是( )。

A. 先入先出

B. 先入后出

C. 随机

D. 按地址查找

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96. 1. 随机存储器RAM在正常工作状态下,具有的功能是( )

A. 只有读功能

B. 只有写功能

C. 既有读功能,又有写功能

D. 无读写功能

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97. 2. 当电源断掉后又接通,RAM中的信息不会改变。

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98. 3. RAM由若干位存储单元组成,每个存储单元可存放一位二进制信息。

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99. 1. 要构成容量为4K×8的RAM,需要多少片容量为256×4的RAM?( )

A. 2

B. 4

C. 8

D. 32

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100. 2. 用6264组成64K×16的存储器,需( )片6264。

A. 8

B. 16

C. 2

D. 4

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101. 3. 存储器字数的扩展可以利用外加译码器控制数个芯片的片选输入端来实现。

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102. 4. 寻址16K×8的RAM需要( )根地址线。

A. 14

B. 6

C. 8

D. 16

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103. 1. 下列器件可以实现组合逻辑函数的是( )

A. DRAM

B. SRAM

C. EPROM

D. 以上都对

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104. 2. 只读存储器ROM,当电源断电后再通电时,所存储的内容( )

A. 全部改变

B. 不确定

C. 全部为0

D. 保持不变

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105. 3. ROM的逻辑结构可以看成一个与门阵列和一个或门阵列的组合。

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106. 4. 当电源断掉后又接通,则ROM中的信息不会改变。

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107. 5. 用ROM实现组合逻辑电路时,所实现函数的表达式应变换成( )

A. 最简与或式

B. 标准与或式

C. 最简与非-与非式

D. 最简或非-或非式

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108. 1. 7可以是一个八进制数

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109. 2. 写出4位二进制数的最大数

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110. 3. 12可以表示的进制数有一下哪些()

A. 十进制

B. 二进制

C. 八进制

D. 十六进制

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111. 1. 负数的补码是反码加1

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112. 2. 正数的原码、反码、补码相同

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113. 3. 二进制的运算规则是逢十进一

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114. 1. 十进制数25用8421BCD码表示为

A. 10101

B. 00100101

C. 100101

D. 10101

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115. 2. 余三码是有权码

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116. 3. 将二进制码0110转换为格雷码为

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117. 4. 将代码(10000011)8421转换为二进制数

A. (01000011)2

B. (000100110001)2

C. (1010011)2

D. (10000011)2

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118. 5. 十进制数25用余3码表示为( )

A. 01011000

B. 101000

C. 00100101

D. 010101

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119. 1. 表示任意2位无符号十进制数需要( )位二进制数

A. 6

B. 7

C. 8

D. 9

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120. 2. 数字系统中,采用( )可以将减法运算转化为加法运算。

A. 原码

B. ASCII码

C. 补码

D. BCD码

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121. 3. 一位十六进制数可用______________位二进制数表示。

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122. 4. 十进制数14用8421BCD码表示为______________。

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123. 5. 补码1.1000的真值是( )

A. +1.0111

B. -1.0111

C. -0.1001

D. -0.1000

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124. 6. 余3码是( )码,减3后是 ( )码,然后加上后六种状态是 ( ) 码。

A. 无权,8421BCD,8421

B. 余3,8421,5421BCD

C. 8421, 有权,无权

D. 循环,2421BCD,有权

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125. 1. 以下属于逻辑函数的表示方法的是()

A. 真值表

B. 逻辑图

C. 波形图

D. 逻辑函数式

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126. 1. 化简以下逻辑函数式:(按序将答案填在相应空内) 1. 2. 3. 4. 5.

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127. 1. 已知逻辑函数F=A(B+DC),选出下列可以肯定使F=1的状态是( )

A. AB=1,C=0,D=0

B. A=0,BC=0,D=0

C. A=0,BD=0,C=0

D. AC=1,B=0

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128. 2. 对于题图1.2所示的波形, A、B为输入,F为输出,其反映的逻辑关系是( )

A. 同或关系

B. 异或关系

C. 或非关系

D. 或关系

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129. 3. 在题图1.7所示的卡诺图中,化简后的逻辑函数是( )

A.

B.

C.

D.

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130. 4.

A. ×、m、×、×、M、×

B. ×、×、m、×、×、M

C. ×、m、×、×、×、M

D. ×、M、m、×、×、×

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131. 1. 实现下图逻辑电平功能的是什么门电路( )

A. 或门

B. 非门

C. 与门

D. 与非门

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132. 2. 二极管或门只有二极管组成

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133. 1.

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134. 2. TTL电路的电源电压为( )V

A. 5

B. 3

C. 1.5

D. 15

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135. 1. 电路及其输入电压uI1和uI2的波形如下图所示,二极管导通电压UD=0.7V。试确定在0~t1期间, uo=____V。

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136. 2. 电路如图所示。试分析D1,D2工作状态。(填入导通或截止,否则不得分) D1____;D2____。

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137. 3. 已知放大电路中三极管的三个极的直流电位如图所示,则该三极管上、中、下的三个电极分别对应三极管的_________。

A. 基极,发射极,集电极

B. 发射极,集电极,基极

C. 集电极,发射极,基极

D. 发射极,基极,集电极

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138. 4. 根据晶体管型号及实测对地直流电压数据(设直流电压表的内阻非常大),则管子的类型为______。

A. PNP锗管

B. NPN锗管

C. PNP硅管

D. NPN硅管

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139. 5. 电路如图所示,二极管导通电压为0.7V,则______。

A. D1导通,D2、D3均截止

B. D1、D2、D3均截止

C. D1、D2、D3均导通

D. D2导通, D1、D3均截止

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140. 1.

A. 110

B. 001

C. 111

D. 101

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141. 1. 用四选一数据选择器实现函数 ,应使( )

A. D0=D2=0,D1=D3=1

B. D0=D2=1,D1=D3=0

C. D0=D1=0,D2=D3=1

D. D0=D1=1,D2=D3=0

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142. 2. 一个十六路数据选择器,其数据输入端有 个。

A. 2

B. 4

C. 8

D. 16

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143. 3. 数据选择器和数据分配器的功能正好相反,互为逆过程。

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144. 4. 一个十六路数据选择器,其地址输入端有 个。

A. 2

B. 4

C. 8

D. 16

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145. 1. 串行进位加法器是由全加器构成的。

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146. 2. 超前进位加法器的运算速度要比串行进位加法器的运算速度快。

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147. 3. 如图所示串行进位加法器当A=11,B=01时,高位的进位输出端为 。

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148. 4. 如下图所示,当输入A为0101,B为1001时,S2= .

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149. 1. 4线-10线译码器中输出状态只有F2=0,其余输出端均为1,则它的的输入状态应取( )

A. 1001

B. 0010

C. 1000

D. 1101

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150. 2.

A. 110

B. 101

C. 001

D. 011

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151. 3. 在下列逻辑电路中,是组合逻辑电路的有( )

A. 具有反馈性能的寄存器

B. 编码器

C. 译码器

D. 数据选择器

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152. 4. 采用4位比较器7485对两个四位二进制数进行比较时,先比较___________位。(填入最高或最低,否则不得分)

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153. 1. 由与非门构成的SR锁存器,其现态Q为1,要想其次态输出为1,则SR的输入取值应为( )

A. 00

B. 01

C. 11

D. 10

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154. 2. 由与非门构成的基本SR锁存器,当SR=01时,现态Q=0,则次态Q'=

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155. 3. 基本SR锁存器,现态为1,若此时输入S=R=0,锁存器的次态变为1,则该锁存器是由2个基本( )非门构成

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156. 4. 基本SR锁存器是一种单稳态触发器。

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157. 1. D触发器有( )种功能。

A. 1

B. 2

C. 3

D. 4

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158. 2. RS触发器有( )种功能。

A. 1

B. 2

C. 3

D. 4

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159. 3. 反映触发器在输入作用下现态和次态转移关系的是( )

A. 状态表

B. 激励表

C. 功能表

D. 真值表

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160. 4. T触发器有( )中功能。

A. 1

B. 2

C. 3

D. 4

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161. 5. 同步RS触发器的约束方程为

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162. 1. 对175个信号进行二进制编码,那么编码器的输出至少需要( )个。

A. 6

B. 7

C. 8

D. 9

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163. 2. 用三-八译码器74LS138实现对23个信号的译码,则至少需要( )片74LS138

A. 3

B. 4

C. 8

D. 23

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164. 3. RS触发器有( )种功能。

A. 1

B. 2

C. 3

D. 4

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165. 4. 在下图(a)所示的D触发器电路中,设触发器初态为0,若输入端D的波形如图(b)所示,则输出端Q的波形如图(b)所示。

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166. 1. 时序逻辑电路的描述方法有哪些,写出其中四种即可 , , ,

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167. 2. 时序逻辑电路按照触发器动作特点分类可分为哪几类( )

A. 同步时序电路

B. Mealy型时序电路

C. Moore型时序电路

D. 异步时序电路

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168. 3. 时序逻辑电路通常包含组合电路和存储电路两个组成部分。

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169. 4. 同步时序逻辑电路具有统一的时钟CP控制。

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170. 1. 下列逻辑电路不具有记忆功能的是( )

A. 译码器

B. 触发器

C. 寄存器

D. 计数器

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171. 2. 以下电路不属于时序逻辑电路的是( )

A. 触发器

B. 寄存器

C. 编码器

D. 计数器

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172. 3. 同步时序电路的工作速度高于异步时序电路。

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173. 4. 构成计数电路的器件必须有记忆能力。

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174. 5. 时序逻辑电路特点中,下列叙述正确的是( )

A. 电路任一时刻的输出只与当时输入信号有关

B. 电路任一时刻的输出只与电路原来状态有关

C. 电路任一时刻的输出与输入信号和电路原来状态均有关

D. 电路任一时刻的输出与输入信号和电路原来状态均无关

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175. 1. 一般情况下,寄存器与移位寄存器优先级别最高的是

A. 保持

B. 复位

C. 置位

D. 右移

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176. 2. 某时序电路的外输入为X,输出为F,状态Q1Q0排序,其状态转换表如下表所示,则该电路的逻辑功能是

A. 模4减法计数器

B. 模3减法计数器

C. 模3加/减计数器

D. 模4加/减计数器

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177. 3. 集成计数器74161和74163的区别是

A. 复位

B. 置位

C. 预置数

D. 时钟信号

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178. 4. 可以进行移位操作的电路有

A. 具有异步复位功能的异步时序电路

B. 同步时序电路

C. 异步时序电路

D. 带同步预置的同步时序电路

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179. 1. 移位寄存器只能串行输出。

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180. 2. 构成计数器的电路必须具有记忆功能。

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181. 3. 试判断下图所示的时序逻辑电路的状态转换图是否正确 状态转换图:

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182. 4. 一个5位的二进制加法计数器,由00000状态开始,经过75个时钟脉冲后,计数器的状态为

A. 01100

B. 01011

C. 01010

D. 00111

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183. 5. 用n个触发器构成计数器,其最大计数模为( )

A. n

B. 2n

C.

D.

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184. 6. 如下图所示电路,能够实现的功能的是( )

A.

B.

C.

D.

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185. 1. ROM的电路结构包含 、 、 三个组成部分。

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186. 2. 只读存储器是完全不能进行存储内容的重写的。

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187. 3. 以下属于只读存储器分类的是( )

A. PROM

B. EPROM

C. UVEPROM

D. Flash Memory

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188. 1. 用存储容量为16K×1位的存储器芯片来组成一个64K×8位的存储器,则在字方向和位方向分别扩展了()倍

A. 4、2

B. 4、8

C. 8、4

D. 4、4

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189. 2. 一个8K*16位的存储器,其地址线是( )

A. 11

B. 12

C. 13

D. 14

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190. 3. 一个16k×4的存储器使用二维译码的方式,那么地址译码器一共需要( )个与门

A. 128

B. 64

C. 256

D. 32

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191. 4. 一个有32768个存储单元的RAM,它能存储4096个字,则此存储器应有( )根地址线。

A. 10

B. 11

C. 12

D. 13

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192. 1. 约束项就是逻辑函数中不可能出现或者不允许出现的变量取值组合对应的最小项,用卡诺图化简时,可将约束项当作( )。

A. 当作1

B. 当作 0

C. 当作1,也可当作 0

D. 即不当作1,也不可当作 0

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193. 2. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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194. 3. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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195. 4. 用卡诺图化简法化简为最简与或式

A.

B.

C.

D.

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196. 1. 写出下图所示门电路的输出: 若该门电路为TTL电路, Y11=

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197. 2. 写出下图所示门电路的输出: 若图所示门电路为CMOS电路,Y11=

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198. 3. CMOS逻辑电路是以( )为基础的集成电路

A. 三极管

B. NMOS管

C. PMOS管

D. NMOS管和PMOS管

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199. 4. CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。

A. 微功耗

B. 高速度

C. 高抗干扰能力

D. 电源范围宽

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200. 5. CMOS OD门(漏极开路门)的输出端可以直接相连,实现线与。

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201. 6. CMOS 电路比 TTL 电路功耗大。

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202. 1. 设计一个监视交通信号灯工作状态的逻辑电路。正常情况下,红、黄、绿灯只有一个亮,否则发出报警信号。这个逻辑问题中涉及到的输入变量和输出变量分别有几个,代表什么,选择( )。

A. 三个输入变量,分别表示每种灯。一个输出变量,代表报警信号

B. 三个输入变量,分别表示每种灯的状态。一个输出变量,代表是否发出报警信号

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203. 2. 四个人就采购某药品事宜进行表决,多数人同意则通过,否则不通过。设计这个表决电路,输入变量的取值有( )组。

A. 16

B. 8

C. 20

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204. 3. 三个人就采购某设备事宜进行表决,多数人同意则通过,否则不通过。但是,其中一人有一票否决权。设计这个表决电路,真值表是( )。

A.

B.

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205. 4. 三个人就采购某设备事宜进行表决,多数人同意则通过,否则不通过。但是,其中一人有一票否决权。设计这个表决电路,输出函数表达式是( )。

A. F=AB+BC+AC

B. F=BC+A

C. F=AB+AC

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206. 1. 下面逻辑图的输出函数表达式是( )。

A.

B.

C.

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207. 2. 下面逻辑图的输出函数表达式是( )。

A.

B.

C.

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208. 3. 下面逻辑图的输出函数表达式是( )。

A.

B.

C.

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209. 4. 下面逻辑图的输出函数表达式是( )。

A.

B.

C.

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210. 1. 下图是( )。

A. 半加器

B. 全加器

C. 比较器

D. 同或运算

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211. 2. 下面真值表的电路实现的功能是( )。

A. 半加器

B. 全加器

C. 比较器

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212. 3. 下图器件,当输入变量Ai、Bi、Ci-1的取值分别为1、0、1时,( )。

A. Si=1, Ci=0

B. Si=1, Ci=1

C. Si=0, Ci=1

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213. 4. 下图电路,当输入变量Ai、Bi的取值分别为1、0时,( )。

A.

B.

C.

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214. 1. 下列选项中叙述正确的是( )。

A. 普通编码器允许两个以上信息同时输入

B. 优先编码器在任何情况都只对优先级别最高的信息进行编码

C. 优先编码器对优先级别较高的有效输入信息进行编码

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215. 2. 一个键盘上的按键各不相同,共16个按键。对这些信息编码需要( )位二进制码。

A. 3

B. 4

C. 5

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216. 3. 下表为8线——三线优先编码器的真值表,相关叙述不正确的是( )

A. 输入变量的值为0代表信息有输入,1为信息无输入。

B. 最后一行是对I0编码

C. 优先级别最高的信息是I7

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217. 4. 下面关于8421BCD码优先编码器叙述正确的是( )。

A. 输入变量有10个,输出变量有3个。

B. 如果优先级别最高的是I9,则当I9输入1时,一定编码输出为1001

C. 如果I7输入1,一定编码输出0111

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218. 1. 8选1数据选择器74LS151有( )位地址变量。

A. 3

B. 4

C. 5

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219. 2. 24选1的数据选择器需要( )位地址变量。

A. 3

B. 4

C. 5

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220. 3. 下图的输出函数F的表达式是( )。

A.

B.

C.

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221. 4. 下图的输出函数F的表达式是( )。

A.

B.

C.

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222. 1. 没有置0功能的触发器是(  )。

A. RS-FF;

B. JK-FF;

C. D-FF;

D. T-FF。

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223. 2. rs触发器的特性方程为

A.

B.

C.

D.

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224. 3. 从结构上看,时序逻辑电路的基本单元是 .

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225. 4. rs触发器的逻辑功能有( )( )( )

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226. 1. 观察采用上升沿触发的 T ¢ 触发器电路如图所示,此电路是( )

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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227. 2. 观察如图所示,此电路是( )

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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228. 3. 如下图所示是集成异步二-五-十进制计数器,用它构成8421码十进制计数器时,需使( )。

A.

B.

C.

D.

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229. 4. 已知集成4位十进制异步加法计数器74290的状态表(左)和构成的N进制计数器(右),该N进制计数器的模值为( )

A. 5

B. 6

C. 8

D. 11

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230. 1. 模拟量在转换为数字量前必须进行( )滤波。

A. 带通

B. 高通

C. 抗混叠

D. 抗纹波

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231. 2. 10位逐次逼近型A/D 转换器而言,若参考电压=4.096V,当vI=1.003V时输出的二进制数D9...D0=( )。

A. 0011111100

B. 0010111101

C. 0011111010

D. 0010111110

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232. 3. 采样速率(Sample Rate)一般比转换速率( )。

A. 快

B. 慢

C. 相等

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233. 4. 从性能角度看,转换速率最快的ADC是( )。

A. 并联比较型

B. 逐次比较型

C. 双积分型

D. Σ-Δ型

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234. 1. 一个四输入端与非门,使其输出为1的输入变量取值组合有( )种。

A. 15

B. 8

C. 7

D. 1

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235. 2. 证明两个函数是否相等,只要比较它们的真值表是否相同即可( )

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236. 3. 当决定一件事情的所有条件全部具备时,这件事情才发生,这样的逻辑关系称为非( )

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237. 4. 若两个函数相等,则它们的真值表一定相同;反之,若两个函数的真值表完全相同,则这两个函数未必相等( )

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238. 1. 全部的最小项之和恒为( )。

A. 0

B. 1

C. 0或1

D. 非0非1

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239. 2. 对任意一个最小项,只有一组变量取值使得它的值为1( )

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240. 3. 任意的两个最小项之积恒为0( )

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241. 4. 在逻辑函数表达式中,如果一个乘积项包含的输入变量最少,那么该乘积项叫做最小项( )

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242. 5. 任何一个函数都可以写成最小项表达式的形式。( )

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243. 1. 用公式法化简为最简与或式是( )。

A.

B.

C.

D.

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244. 2. 下列各式中错误的是( )。

A.

B.

C.

D.

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245. 3.

A. 1

B. A

C. C

D. B

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246. 4. 逻 辑 式,化 简 后 为( )。

A.

B.

C.

D.

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247. 5. 用公式法化简为最简与或式为( )。

A.

B.

C.

D.

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248. 1. 一个16选1的数据选择器,其地址输入(选择控制输入)端有( )个

A. 1

B. 2

C. 4

D. 16

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249. 2. 一个4选1的数据选择器,其数据输入端有( )个

A. 1

B. 2

C. 4

D. 8

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250. 3. 用4选1数据选择器,不能实现3变量的逻辑函数。

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251. 1. 主从触发器能避免触发器的空翻现象。

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252. 1. 一位8421BCD计数器,至少需要( )个触发器。

A. 3

B. 4

C. 5

D. 10

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253. 2. 输出为8421BCD码的计数器为十进制计数器。

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254. 3. 计数器能够记忆输入CP脉冲的最大数目,叫做这个计数器的长度,也称为计数器的“模”。

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255. 4. 4位二进制计数器的模为4。

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256. 5. 构成5进制计数器至少需要5个触发器。

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257. 1. 要想把串行数据转换成并行数据,应选( )。

A. 并行输入串行输出方式

B. 串行输入串行输出方式

C. 串行输入并行输出方式

D. 并行输入并行输出方式

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258. 2. 时序逻辑电路由存储电路和触发器两部分组成。

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259. 1. 单稳态触发器的主要用途是( )

A. 整形、延时、鉴幅

B. 延时、定时、存储

C. 延时、定时、整形

D. 整形、鉴幅、定时

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260. 2. 单稳态触发器和施密特触发器不能自动地产生矩形脉冲,但可以把其他形状的信号变换成矩形波。

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261. 3. 单稳态触发器只有一个稳定状态。

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262. 1. 多谐振荡器可产生的波形是( )

A. 正弦波

B. 矩形脉冲

C. 三角波

D. 锯齿波

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263. 2. 多谐振荡器与单稳态触发器的区别之一是( )

A. 前者有2个稳态,后者只有1个稳态

B. 前者没有稳态,后者有2个稳态

C. 前者没有稳态,后者只有1个稳态

D. 两者均只有1个稳态,但后者的稳态需要一定的外界信号维持

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264. 3. 多谐振荡器是一种自激振荡电路,不需要外加输入信号,就可以自动地产生矩形脉冲。

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265. 4. 单稳态触发器的暂稳态时间与输入触发脉冲宽度成正比。

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266. 5. 施密特触发器电路具有两个稳态,而多谐振荡器电路没有稳态。

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267. 1. 用555定时器构成单稳态触发器,其输出的脉宽为( )

A. 0.7RC

B. 1.1RC

C. 1.4RC

D. 1.8RC

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268. 2. 由555定时器构成的单稳态触发器,其输出脉冲宽度取决于( )

A. 电源电压

B. 触发信号的幅度

C. 触发信号的宽度

D. 外接电阻和电容的数值

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269. 1. (100110)2=()8

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270. 2. (11.25)10=()2

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271. 3. (100110)2=()10

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272. 4. (11110.010111)2=(36.27)8

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273. 5. 8F是十六进制数

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274. 1. A=1,A·A′=

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275. 2. 1+A=

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276. 3. A=1,A′=

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277. 1. L=AB+C 的对偶式为

A. A+BC

B. (A+B )C

C. C .A+B+C

D. ABC

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278. 2. A+A′=

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279. 3. A+A·B=

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280. 4. 逻辑代数的基本定理有代入定理、反演定理、对偶定理

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281. 1. 写出下图逻辑电路的逻辑函数式(以F=的形势填入,按顺序写出X、Z、Y的组合)

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282. 2. 一个逻辑函数的全部最小项之积恒等于1

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283. 3. 试判断下图门电路的输出是否正确

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284. 4. 试判断下图逻辑门的输出是否正确

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285. 5. 下图函数的最小项表达式正确的是哪一项?

A.

B.

C.

D.

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286. 1. MOS管的三个极分别为 、 、

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287. 2. 场效应管是电压控制电流的器件

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288. 3. N沟道增强型的开启电压为正

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289. 1. MOS管有三个工作区域( )

A. 截止区

B. 可变电阻区

C. 饱和区

D. 放大区

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290. 2. 分析以下电路,当A=B=0时,Y 的输出为多少

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291. 3. 分析以下电路,当A=1,EN=0时,Y 的输出为多少

A. 0

B. 1

C. 无法求解

D. 呈现高阻态,Y没有输出

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292. 1. 晶体管有3个工作区,在数字电路中,它工作在( )区

A. 饱和

B. 截止

C. 放大

D. 截止或饱和

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293. 2. 晶体管在饱和状态发射结正偏,集电结

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294. 3. 晶体三极管进入饱和状态后CE间的压降约为 V

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295. 4. 晶体管截止时 发射结和集电结均反偏

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296. 1. 逻辑电路按照是否具有记忆功能分为同步时序逻辑电路和组合逻辑电路。

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297. 2. 从电路结构看,由逻辑门电路组成,不包含任何记忆元件的就是组合逻辑电路。

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298. 3. 以下属于组合逻辑电路的特点是( )

A. 输入、输出之间没有反馈延迟通路

B. 电路中不含有记忆功能的元件

C. 输出与电路原来的状态有关

D. 电路结构上不包含存储单元,仅仅是由各种门电路组成

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299. 1. 下图所示组合逻辑电路,其功能是( )

A. 8421码转余3码

B. 8421码转2421码

C. 二进制码转格雷码

D. 二进制码转8421码

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300. 2. 利用卡诺图化简函数F(A,B,C,D) = ∑ m(7,11,12,13,14,15)+∑ d(0,2,3,8,10),求出的最简表达式是( )

A.

B.

C.

D.

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301. 1. 组合逻辑电路在任何时刻产生的稳定输出值仅仅取决于该时刻各输入值的组合,而与过去的输入值无关。

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302. 2. 组合逻辑电路的输出与输入的关系可用真值表和逻辑函数描述。

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303. 3. 关于下面图示电路的功能,描述正确的是( )

A. 输入变量ABC中只要有1个变量取值为1,输出为1。

B. 输入变量ABC中只要有2个或2个以上的变量取值为0,输出为1。

C. 输入变量ABC中只要有2个或2个以上的变量取值相同,输出为1。

D. 当输入变量ABC中3个变量的取值相同,输出为1。

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304. 1. 在下列逻辑电路中,是组合逻辑电路的有___________。

A. 具有记忆功能的寄存器

B. 译码器

C. 编码器

D. 七段显示译码器

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305. 2. 下图是共阴极七段LED数码管显示译码器框图,若要显示字符“5”,则译码器输出a~g应为 (如显示0,a~g的输出为1111110)

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306. 3. 如图所示4线-16线译码器,当D3=0时,若输入D3D2D1D0=0110,则第一片译码器的输出为

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307. 1. 寄存器由触发器构成

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308. 2. 一个触发器可以记录多位二进制码

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309. 3. 3个触发器可以构成能寄存 位二进制数码的寄存器。

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310. 4. 触发器常用的描述方法有哪些( )

A. 状态表

B. 次态方程

C. 激励表

D. 功能表

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311. 1. 触发器的( )是触发器从现态转移到某种状态时,对输入条件的要求。

A. 状态表

B. 功能表

C. 激励表

D. 真值表

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312. 2. 钟控SR触发器的次态方程为( )。

A.

B.

C.

D.

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313. 3. 钟控JK触发器的次态方程为

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314. 4. 在下图(a)所示的D触发器电路中,设触发器初态为0,若输入端D的波形如图(b)所示,则输出端Q的波形如图(b)所示。

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315. 1. 如图所示触发器,请写出其次态方程

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316. 2. 一个CP脉冲作用下,引起触发器两次或多次的翻转的现象称为触发器的

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317. 3. 基本RS触发器在正常工作时,不允许输入R=S=1的信号,故此,其约束条件为

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318. 1. 存储8位二进制信息要 个触发器。

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319. 2. 对于D触发器,欲使,应使输入D= 对 于 D 触 发 器 , 欲 使 Q n + 1 = Q n , 应 使 输 入 D

A. 0

B. 1

C. Q

D.

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320. 3. 边沿D触发器是一种双稳态触发器。

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321. 1. 下列器件中属于时序部件的是( )

A. 计数器

B. 译码器

C. 多路选择器

D. 数据选择器

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322. 2. N个触发器可以构成计数器最大计数长度为( )

A. N

B. 2N

C.

D.

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323. 3. 同步时序电路和异步时序电路相比,其差异在于后者( )

A. 没有触发器

B. 没有稳定状态

C. 没有统一的时钟脉冲控制

D. 输出只与内部状态有关

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324. 4. 计数器工作时,主要对时钟脉冲CP出现的个数进行计数。

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325. 5. 异步时序电路的各级触发器的类型不同。

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326. 1. 移位寄存器有接收、暂存、清除和数码移位等作用。

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327. 2. 移位寄存器只能串行输出。

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328. 3. 寄存器具有存储数码和信号的功能。

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329. 4. 如图所示移位寄存器的初始状态为111,在连续2个CP脉冲作用下Q2,Q1,Q0各端的输出情况为 (答案按照Q2,Q1,Q0的顺序填入)

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330. 1. 内存中可以存储的数据单位的总数称为:地址。

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331. 2. 半导体存储器只能存储一位二值信息。

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332. 3. 存储容量和存取速度是衡量半导体存储器的重要性能指标。

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333. 4. ROM里存储的内容可以进行修改。

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334. 5. 目前大容量的存储器均采用MOS工艺制作而成。

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335. 1. DRAM比SRAM的内部结构更加复杂。

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336. 2. SRAM的R指的是Read

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337. 3. 关于SRAM,下面叙述正确的是:

A. 非易失性只读存储器

B. 非易失性读写存储器

C. 易失性只读存储器

D. 易失性读写存储器

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338. 1. 容量为4K*8位的RAM存储器芯片,有 条地址线, 条位线。

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339. 2. RAM的一般结构由 、 和读/写控制电路三部分组成。

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340. 3. 半导体存储器从读、写功能上可以分为ROM和 。(填入英文简称否则不得分)

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341. 4. 随机存储器RAM的I/O端口为输入端口时,应使( )

A.

B.

C.

D.

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342. 5. 具有对存储矩阵中的存储单元进行选择作用的是存储器中的( )

A. 地址译码器

B. 读写控制电路

C. 存储矩阵

D. 片选控制

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343. 6. 只读存储器ROM,当电源断电后在通电,所存储的内容( )

A. 全部改变

B. 全部为0

C. 不确定

D. 保持不变

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344. 7. 随机存储器SRAM,当电源断电后在通电时,所存储的内容( )

A. 全部改变

B. 全部为0

C. 不确定

D. 保持不变

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345. 8. 用户不能改变存储内容的存储器是( )

A. MROM

B. PROM

C. EPROM

D. 以上都对

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346. 9. 容量为1024*4的RAM,含有基本存储电路的数量为( )

A. 1024

B. 4

C. 10

D. 4096

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347. 10. 正常工作状态下,可以随时进行读写操作的存储器是( )

A. EPROM

B. PROM

C. MROM

D. RAM

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348. 1. 用卡诺图法求F(A, B, C, D)=∑m(0, 2, 5, 7, 8, 10, 13, 15)的最简与或式是( )。

A.

B.

C.

D.

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349. 2. 用卡诺图化简函数为最简单的与或式是( )。

A.

B.

C.

D.

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350. 3. 用卡诺图化简函数为最简单的与或式是( )。

A.

B.

C.

D.

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351. 4. 用卡诺图化简逻辑式,化 简 后 为( )。

A.

B.

C.

D.

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352. 1. 常见的开关元件有( )( )( )

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353. 2. cmos管的三个工作区域分别是:( )( )( ),用来模拟开关的是哪两个工作区域( )。

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354. 1. 下图为3线—8线译码器,有关叙述正确的是( )。

A. 输出变量为1时,代表对输入变量进行译码

B. 当输入变量A2、A1、A0的取值分别为1、0、1时,输出端 ,其它输出1

C. 当使能端都是0时,允许译码。否则禁止工作。

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355. 2. 下图的输出函数表达式是( )。

A.

B.

C.

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356. 3. 下图所示为( )数码管。

A. 共阳极

B. 共阴极

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357. 4. 下图所示数码管,当a、b、c、d、e、f、g分别接1111001时显示( )

A. 1

B. 3

C. 6

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358. 1. JK触发器的特性方程( )

A.

B.

C.

D.

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359. 2. JK触发器在CP脉冲的作用下,若要使 ,则输入端必须为( )。

A. J=K=1;

B. J=K=0;

C. J=0,K=1;

D. J=1,K=0。

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360. 3. 图中触发器的初始状态为0,第一个时钟的下降沿后触发器的状态变为( )

A. 0

B. 1

C. 不确定

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361. 4. 时序逻辑电路在任一时刻的稳定输出与( )有关。

A. 输入信号

B. 电路原状态

C. 时钟信号

D. 其余选项均不是

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362. 5. 同一时钟CLK控制各触发器的计数器称为异步计数器。

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363. 1. 某计数器的输出波形如图所示,该计数器是( )进制计数器。

A. 模6计数器

B. 模7计数器

C. 模8计数器

D. 模16计数器

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364. 2. 观察如图所示,此电路是( )

A. 模8二进制同步加法计数器

B. 模8二进制异步加法计数器

C. 模16二进制同步加法计数器

D. 模16二进制异步加法计数器

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365. 3. 已知集成4位二进制同步加法计数器74LS161的状态表(左)和构成的N进制计数器(右),该N进制计数器的模值为( )

A. 5

B. 6

C. 10

D. 11

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366. 4. 已知集成4位二进制同步加法计数器74LS163的状态表(左)和构成的N进制计数器(右),该N进制计数器的模值为( )

A. 5

B. 6

C. 10

D. 11

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367. 1. 一个4位二进制同步加法计数器用作分频器时,若计数脉冲的频率为,现需要20KHZ的信号,取自( )。

A.

B.

C.

D.

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368. 2. 已知集成4位二进制同步加法计数器74LS163的状态表如下: 若用74163同步清零构成300进制计数器,需要( )片74163。

A. 1

B. 2

C. 3

D. 4

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369. 3. 已知集成4位十进制异步加法计数器74290的状态表,设计60进制计数器为( )

A.

B.

C.

D.

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370. 1. 用N位移位寄存器构成的扭环形计数器的模是

A. N

B. 2N

C. 4

D. 8

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371. 2. 扭环形计数器的特点是

A. 有效环中任一状态下只有一级触发器为1

B. 有效环中任一状态下只有一级触发器为0

C. 有效循环中,从任一状态转到下一个状态时,只有一级触发器翻转。

D. 有效循环中,从任一状态转到下一个状态时,只有一级触发器不翻转。

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372. 3. 4位双向移位寄存器74LS194的状态表如下。则当Q0、Q1、Q2和Q3的现态为1010时,使,控制端M1=0,M0=1,串行输入端DIR=0,DIL=1,并行输入端为全0,一个时钟CP的上升沿过后,输出的状态为( )

A. 保持不变

B. 0101

C. 1000

D. 1101

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373. 4. 4位双向移位寄存器74LS194的状态表如下。电路首先给一个5个时钟周期长度的低电平的启动信号,10个时钟CP的上升沿过后,输出的状态转换图为( )

A.

B.

C.

D.

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